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嵌入式培訓(xùn)

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　　　　　　數(shù)字IC前端設(shè)計高級培訓(xùn)班
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
        ◆ 電路系統(tǒng)的基本概念。
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       為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限3到5人，多余人員安排到下一期進行。
   上課時間和地點
上課地點：【上海】：同濟大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）：數(shù)字IC前端設(shè)計高級培訓(xùn)班：2025年11月17日..合作共贏....實用實戰(zhàn)....實戰(zhàn)培訓(xùn)....用心服務(wù)..........--即將開課--............................
   實驗設(shè)備
　    ☆資深工程師授課

        ◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學(xué)員免費推薦工作

        

        專注高端培訓(xùn)17年，曙海提供的課程得到本行業(yè)的廣泛認可，學(xué)員的能力
        得到大家的認同，受到用人單位的廣泛贊譽。

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       ◆在讀學(xué)生憑學(xué)生證，可優(yōu)惠500元。
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        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。 。專注高端培訓(xùn)17年，曙海提供的課程得到本行業(yè)的廣泛認可，學(xué)員的能力得到大家的認同，受到用人單位的廣泛贊譽。
　　　　　　　　數(shù)字IC前端設(shè)計高級培訓(xùn)班
課程說明
本課程講授基于Synopsys EDA tools構(gòu)成的ASIC/SOC數(shù)字電路前端開發(fā)流程，授課內(nèi)容包括電路開發(fā)前期的系統(tǒng)定義、功能劃分、RTL代碼編寫技巧、驗證平臺TestBench編寫技巧、電路仿真技巧、ASIC綜合技術(shù)、ASIC靜態(tài)時序分析技術(shù)、DFT設(shè)計等。學(xué)員通過運用數(shù)字邏輯、硬件描述語言完成一個中等規(guī)模的專題項目設(shè)計，在課程過程中掌握數(shù)字集成電路的coding、仿真、綜合、靜態(tài)時序分析、可測性設(shè)計、一致性驗證等一系列數(shù)字電路前端流程中的設(shè)計技巧，終使學(xué)員達到能獨立完成中等規(guī)模電路模塊的前端設(shè)計水平。
?
一、部分預(yù)備知識回顧
重點回憶預(yù)備課程內(nèi)容，講解設(shè)計流程，Verilog基礎(chǔ)知識以及仿真基本知識，UNIX基礎(chǔ)知識，設(shè)計database的管理。
二、ASIC綜合技術(shù)
??? 重點講解數(shù)字電路設(shè)計的綜合技術(shù)的基本概念，綜合流程和工程經(jīng)驗，使學(xué)員掌握基于synopsys DC的綜合技巧。
內(nèi)容包括：?
綜合機理的分析；組合電路和時序電路實現(xiàn)規(guī)則和實例分析；基于tcl綜合的流程,優(yōu)化處理和調(diào)試技術(shù)；綜合處理與后端流程的聯(lián)系；可綜合代碼技術(shù)；需深入研究的內(nèi)容；LPC 接口模塊綜合實驗
三、ASIC DFT技術(shù)
??? 介紹可測試設(shè)計技術(shù)，使學(xué)員掌握基于Synopsys DFT 的可測性電路設(shè)計方法
內(nèi)容包括：
背景分析；組合電路和時序電路的測試；可測試設(shè)計；需深入研究的內(nèi)容；DFT compile 使用(基于TCL的可測試性設(shè)計流程)；LPC接口模塊DFT實驗
四、ASIC 靜態(tài)時序分析技術(shù)
??? 介紹靜態(tài)時序分析技術(shù)；使學(xué)員掌握基于Synopsysy PrimeTime的靜態(tài)時序分析技術(shù)。
內(nèi)容包括：
背景分析；電路時序分析的基礎(chǔ)內(nèi)容；工具的使用；靜態(tài)時序分析模式選擇；注意事項及需深入研究的內(nèi)容；LPC接口模塊實驗
五、一致性驗證（Formal）技術(shù)介紹（2學(xué)時）
??? 介紹一致性驗證技術(shù)，使學(xué)員了解基于Synopsys Formality 的一致性驗證方法
內(nèi)容包括：
背景分析；工具的使用介紹
六、設(shè)計項目
?
使用的EDA工具
Unix操作系統(tǒng)；vi/vim:verilog輸入；SCCS/CVS 版本管理工具
Cadence ncverilog:仿真工具；Simvision/nWave/signalscan 波形工具
synopsys dc:綜合工具；synopsys dft:可測試性設(shè)計工具
synopsys pt:靜態(tài)時序分析工具；synopsys formality一致性校驗工具
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項目實踐：
本課程專題實驗是構(gòu)造一個8位CPU（8051）的外部Cache控制器，用于實現(xiàn)CPU通過LPC協(xié)議(Intel的一種主板總線協(xié)議)訪問外部LPC FW Hub(Burst訪問)的執(zhí)行程序。本項目包括CPU core接口模塊,控制狀態(tài)寄存器模塊,two-way組相聯(lián)的cache控制模塊,SRAM控制模塊,LPC 接口模塊。學(xué)員可以從中學(xué)習(xí)如何從IP,標準接口spec和Cache算法入手，進行項目的Architecture設(shè)計，完成模塊劃分，設(shè)計spec和RTL代碼，建立仿真計劃和仿真環(huán)境，完成整個項目的功能仿真到綜合、STA，以及一致性驗證,實現(xiàn)一個較完整的SOC設(shè)計流程。設(shè)計規(guī)模在萬門級。在0.25um工藝庫下，頻率不小于100MHz。
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培訓(xùn)目標
幫助學(xué)員熟悉并掌握典型數(shù)字ASIC/SOC芯片前端開發(fā)流程和設(shè)計技巧，以及相關(guān)設(shè)計軟件的使用，課程結(jié)束后學(xué)員可積累相當于1年左右的實際工作經(jīng)驗，能夠獨立完成ASIC/SOC中等模塊的前端設(shè)計。
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報名要求：有數(shù)字電路設(shè)計和硬件描述語言的基礎(chǔ)或自學(xué)過相關(guān)課程。
 

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備案號:滬ICP備08026168號
.(2012年12月17日........,,,...........................................)...............................................................
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